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1、長(zhǎng)沙理工大學(xué) 數(shù)字電子技術(shù)基礎(chǔ)復(fù)習(xí)試卷及答案數(shù)字電子技術(shù)試卷(1)一 填空（16）1十進(jìn)制數(shù)123的二進(jìn)制數(shù)是 1111011；十六進(jìn)制數(shù)是 7B。2100001100001是8421BCD碼，其十進(jìn)制為861 。3邏輯代數(shù)的三種基本運(yùn)算是 與， 或 和 非。4三態(tài)門(mén)的工作狀態(tài)是 0， 1 ， 高阻。5描述觸發(fā)器邏輯功能的方法有 真值表，邏輯圖，邏輯表達(dá)式，卡諾圖，波形圖。6施密特觸發(fā)器的主要應(yīng)用是 波形的整形 。7設(shè)4位D/A轉(zhuǎn)換器的滿度輸出電壓位30伏，則輸入數(shù)字量為1010時(shí)的輸出模擬電壓為 。8實(shí)現(xiàn)A/D轉(zhuǎn)換的主要方法有 ， ， 。二 判斷題（10）1BCD碼即8421碼 （ 錯(cuò) ）2

2、.八位二進(jìn)制數(shù)可以表示256種不同狀態(tài)。 （ 對(duì) ）3TTL與非門(mén)與CMOS與非門(mén)的邏輯功能不一樣。 （ ）4多個(gè)三態(tài)門(mén)的輸出端相連于一總線上，使用時(shí)須只讓一個(gè)三態(tài)門(mén)傳送信號(hào)，其他門(mén)處于高阻狀態(tài)。 （對(duì) ）5計(jì)數(shù)器可作分頻器。 （ 對(duì) ）三化簡(jiǎn)邏輯函數(shù)（14）1用公式法化簡(jiǎn)，化為最簡(jiǎn)與或表達(dá)式。解；2用卡諾圖化簡(jiǎn)，化為最簡(jiǎn)與或表達(dá)式。四電路如圖1所示，要求寫(xiě)出輸出函數(shù)表達(dá)式，并說(shuō)出其邏輯功能。（15）解；， ，全加器，Y為和，為進(jìn)位。五觸發(fā)器電路如圖2（a）,（b）所示，寫(xiě)出觸發(fā)器的次態(tài)方程； 對(duì)應(yīng)給定波形畫(huà)出Q端波形（設(shè)初態(tài)Q0）(15)解；（1），（2）、六試用觸發(fā)器和門(mén)電路設(shè)計(jì)一個(gè)同步的

3、五進(jìn)制計(jì)數(shù)器。（15） 七用集成電路定時(shí)器555所構(gòu)成的自激多諧振蕩器電路如圖3所示，試畫(huà)出VO，VC的工作波形，并求出振蕩頻率。（15） 數(shù)字電子技術(shù)試卷(2)三 填空（16）1十進(jìn)制數(shù)35.85的二進(jìn)制數(shù)是；十六進(jìn)制數(shù)是。2邏輯代數(shù)中邏輯變量得取值為 0、1。3組合邏輯電路的輸出狀態(tài)只與 當(dāng)前輸入有關(guān)而與電路 原狀態(tài)無(wú)關(guān)。4三態(tài)門(mén)的輸出有0、1、高阻，三種狀態(tài)，當(dāng)多個(gè)三態(tài)門(mén)的輸出端連在一根總線上使用時(shí)，應(yīng)注意 只能有1個(gè)三態(tài)門(mén)被選通。 。5觸發(fā)器的基本性質(zhì)有 有兩個(gè)穩(wěn)態(tài)，在觸發(fā)信號(hào)作用下?tīng)顟B(tài)可相互轉(zhuǎn)變，有記憶功能6單穩(wěn)態(tài)觸發(fā)器的主要應(yīng)用是 延時(shí) 。7設(shè)6位D/A轉(zhuǎn)換器的滿度輸出電壓位6.3

4、伏，則輸入數(shù)字量為110111，輸出模擬電壓為 。8一個(gè)8K字節(jié)的EPROM芯片，它的地址輸入端的個(gè)數(shù)是 13 。 判斷題（10）1數(shù)字電路中，化簡(jiǎn)邏輯函數(shù)的目的是為了所設(shè)計(jì)的邏輯電路更簡(jiǎn)單，更經(jīng)濟(jì)，而且其功能不變。 （對(duì) ） 2二進(jìn)制數(shù)1001和二進(jìn)制代碼1001都表示十進(jìn)制數(shù)。 （ 錯(cuò) ） 3觸發(fā)器的輸出狀態(tài)完全由輸入信號(hào)決定。 （ 錯(cuò) ）4模擬量送入數(shù)字電路前，須經(jīng)A/D轉(zhuǎn)換。 （ 對(duì) ） 5多諧振蕩器常作為脈沖信號(hào)源使用。 （對(duì) ） 三化簡(jiǎn)邏輯函數(shù)（14）1用公式法化簡(jiǎn)，化為最簡(jiǎn)與或表達(dá)式。2用卡諾圖化簡(jiǎn)，化為最簡(jiǎn)與或表達(dá)式。四設(shè)計(jì)一個(gè)8421碼的檢碼電路。要求當(dāng)輸入大于等于3、小于等

5、于7時(shí)電路輸出為1，否則電路輸出為0。要求列出真值表，寫(xiě)出邏輯函數(shù)式，畫(huà)出邏輯圖。（15） 五觸發(fā)器電路如圖1（a）,（b）所示，寫(xiě)出觸發(fā)器的次態(tài)方程； 對(duì)應(yīng)給定波形畫(huà)出Q端波形（設(shè)初態(tài)Q0）。(15)六分析圖2電路實(shí)現(xiàn)何種邏輯功能，其中X是控制端，對(duì)X0和X1分別分析，設(shè)初態(tài)為 。（要求寫(xiě)出電路方程，列出狀態(tài)轉(zhuǎn)換表或圖，說(shuō)明其邏輯功能，并說(shuō)明電路能否自啟動(dòng)）（15） 七試用8選1數(shù)據(jù)選擇器和74LS161芯片設(shè)計(jì)序列信號(hào)發(fā)生器。芯片引腳圖如圖3所示，序列信號(hào)為11001101（左位為先）。（15）數(shù)字電子技術(shù)試卷(3)四 填空（16）1十進(jìn)制數(shù)86的二進(jìn)制數(shù)是；8421BCD碼是。2在Y=A

6、B+CD的真值表中，Y1的狀態(tài)有 個(gè)。34位二進(jìn)制數(shù)碼可以編成個(gè)代碼，用這些代碼表示09十進(jìn)制輸?shù)氖畟€(gè)數(shù)碼，必須去掉 代碼。4描述觸發(fā)器邏輯功能的方法有 。5若Q1，J=0，K=1，則。6設(shè)ROM地址為，輸出為，則ROM的容量為 。7一個(gè)8位二進(jìn)制D/A轉(zhuǎn)換器的分辨率為0.025，則輸入數(shù)字量為11010011時(shí)，輸出模擬電壓為 。 8 和 是衡量A/D、D/A轉(zhuǎn)換器性能優(yōu)劣的主要指標(biāo)。 五 回答問(wèn)題（10）1已知XY=XZ，則Y=Z，正確嗎？為什么？2五位環(huán)形計(jì)數(shù)器的時(shí)鐘頻率為10KHz,其輸出波形的頻率是多少？三化簡(jiǎn)邏輯函數(shù)（14）1用公式法化簡(jiǎn)，化為最簡(jiǎn)與或表達(dá)式。2用卡諾圖化簡(jiǎn)，化為最

7、簡(jiǎn)與或表達(dá)式。四由雙4選1數(shù)據(jù)選擇器組成的電路如圖1所示，寫(xiě)出的表達(dá)式。列出的真值表。（15）五某室由3臺(tái)計(jì)算機(jī)工作站，請(qǐng)用紅、黃、綠3種指示燈設(shè)計(jì)一個(gè)監(jiān)視電路，要求：3臺(tái)計(jì)算機(jī)正常工作時(shí)，綠燈亮；只一臺(tái)出故障時(shí)黃燈亮；有兩臺(tái)出故障時(shí)，紅燈亮；若3臺(tái)計(jì)算機(jī)同時(shí)出故障時(shí)，則黃燈和紅燈都亮。試用門(mén)電路設(shè)計(jì)。要求：列出真值表，寫(xiě)出邏輯函數(shù)式，畫(huà)出邏輯電路圖。（15） 六觸發(fā)器電路及輸入波形如圖2所示，要求：寫(xiě)出電路方程，畫(huà)出與Y的對(duì)應(yīng)波形。(設(shè)的初態(tài)為11)（15） 七試用中規(guī)模集成十六進(jìn)制計(jì)數(shù)器74LS161芯片設(shè)計(jì)一個(gè)十三進(jìn)制計(jì)數(shù)器，要求必須包括0000和1111狀態(tài)，利用C端左進(jìn)位輸出。芯片引

8、腳圖如圖3所示。（15）數(shù)字電子技術(shù)試卷(4)六 填空（16）1十進(jìn)制數(shù)3.5的二進(jìn)制數(shù)是；8421BCD碼是。2在的結(jié)果是 。3D觸發(fā)器的狀態(tài)方程為，如果用D觸發(fā)器來(lái)實(shí)現(xiàn)T觸發(fā)器的功能，則T、D間的關(guān)系為 。4一個(gè)64選1的數(shù)據(jù)選擇器，它的選擇控制端有 個(gè)。56位D/A轉(zhuǎn)換器滿度輸出電壓為10伏，輸入數(shù)字為001010時(shí)對(duì)應(yīng)的輸出模擬電壓為伏。 6一片64K8存儲(chǔ)容量的只讀存儲(chǔ)器ROM，有條地址線，有 條數(shù)據(jù)線。7 由555定時(shí)器構(gòu)成的單穩(wěn)態(tài)觸發(fā)器，輸出脈寬。8 和 是衡量A/D、D/A轉(zhuǎn)換器性能優(yōu)劣的主要指標(biāo)。 七 回答問(wèn)題（10）1已知XY=XZ，則Y=Z，正確嗎？為什么？2已知X+Y=

9、XY，則X=Y，正確嗎？為什么？ 三化簡(jiǎn)邏輯函數(shù)（14）1用公式法化簡(jiǎn)，化為最簡(jiǎn)與或表達(dá)式。2用卡諾圖化簡(jiǎn)，化為最簡(jiǎn)與或表達(dá)式。四分析圖1所示電路，要求列出的邏輯表達(dá)式和真值表，并說(shuō)出電路的邏輯功能指出輸入變量和輸出函數(shù)的含義。（15）五觸發(fā)器電路如圖2（a）,（b）所示，寫(xiě)出觸發(fā)器的次態(tài)方程； 對(duì)應(yīng)給定波形畫(huà)出Q端波形（設(shè)初態(tài)Q0）(15)六試用D觸發(fā)器及少量門(mén)器件設(shè)計(jì)，狀態(tài)轉(zhuǎn)換圖為模為3的同步計(jì)數(shù)器。要求有設(shè)計(jì)過(guò)程。（15） 七用集成電路定時(shí)器555所構(gòu)成的自激多諧振蕩器電路如圖3所示，試畫(huà)出VO，VC的工作波形，并求出振蕩頻率。（15） 數(shù)字電子技術(shù)試卷5一選擇題（從每小題的四個(gè)備選答案

10、中，選出一個(gè)正確答案，并將其號(hào)碼填在括號(hào)內(nèi)，每小題2分，共20分）1 將十進(jìn)制數(shù)（3.5）10轉(zhuǎn)換成二進(jìn)制數(shù)是 （ ） 11.11 10.11 10.01 11.102. 三變量函數(shù)的最小項(xiàng)表示中不含下列哪項(xiàng) ( ) m2 m5 m3 m73.一片64k8存儲(chǔ)容量的只讀存儲(chǔ)器（ROM），有 ( ) 64條地址線和8條數(shù)據(jù)線 64條地址線和16條數(shù)據(jù)線 16條地址線和8條數(shù)據(jù)線 16條地址線和16條數(shù)據(jù)線4. 在ADC工作過(guò)程中，包括保持a，采樣b，編碼c，量化d四個(gè)過(guò)程，他們先后順序應(yīng)該是 abcd bcda cbad badc5.以下各種ADC中，轉(zhuǎn)換速度最慢的是 ( ) 并聯(lián)比較型 逐次逼

11、進(jìn)型 雙積分型 以上各型速度相同6. 一個(gè)時(shí)鐘占空比為1：4，則一個(gè)周期內(nèi)高低電平持續(xù)時(shí)間之比為 ( ) 1：3 1：4 1：5 1：67. 當(dāng)三態(tài)門(mén)輸出高阻狀態(tài)時(shí)，輸出電阻為 ( ) 無(wú)窮大 約100歐姆 無(wú)窮小 約10歐姆8.通常DAC中的輸出端運(yùn)算放大器作用是 ( ) 倒相 放大 積分 求和9. 16個(gè)觸發(fā)器構(gòu)成計(jì)數(shù)器，該計(jì)數(shù)器可能的最大計(jì)數(shù)模值是 ( ) 16 32 162 21610.一個(gè)64選1的數(shù)據(jù)選擇器有（ ）個(gè)選擇控制信號(hào)輸入端。 ( ) 6 16 32 64二判斷題（20分）1 兩個(gè)二進(jìn)制數(shù)相加，并加上來(lái)自高位的進(jìn)位，稱為全加，所用的電路為全加器（ ）2三態(tài)門(mén)輸出為高阻時(shí)，

12、其輸出線上電壓為高電平（ ）3 前進(jìn)位加法器比串行進(jìn)位加法器速度慢（ ）4譯碼器哪個(gè)輸出信號(hào)有效取決于譯碼器的地址輸入信號(hào)（ ）5五進(jìn)制計(jì)數(shù)器的有效狀態(tài)為五個(gè)（ ）6施密特觸發(fā)器的特點(diǎn)是電路具有兩個(gè)穩(wěn)態(tài)且每個(gè)穩(wěn)態(tài)需要相應(yīng)的輸入條件維持。（ ）7當(dāng)時(shí)序邏輯電路存在無(wú)效循環(huán)時(shí)該電路不能自啟動(dòng)（）8RS觸發(fā)器、JK觸發(fā)器均具有狀態(tài)翻轉(zhuǎn)功能（ ）9D/A的含義是模數(shù)轉(zhuǎn)換（ ）10構(gòu)成一個(gè)7進(jìn)制計(jì)數(shù)器需要3個(gè)觸發(fā)器（ ）三、簡(jiǎn)答題（每小題5分，共10分）1用基本公式和定理證明下列等式： 。2請(qǐng)寫(xiě)出RS、JK觸發(fā)器的狀態(tài)轉(zhuǎn)移方程，并解釋為什么有的觸發(fā)器有約束方程。四用卡諾圖化簡(jiǎn)以下邏輯函數(shù) （每小題5分，

13、共10分） 1 2，給定約束條件為ABCD0五一個(gè)組合電路具有3個(gè)輸入端A,B,C，一個(gè)輸出端Y，其輸入和輸出波形如圖1所示，使用或非門(mén)設(shè)計(jì)電路。（15分）六8選1數(shù)據(jù)選擇器CC4512的邏輯功能如表4.1所示。試寫(xiě)出圖2所示電路輸出端Y的最簡(jiǎn)與或形式的表達(dá)式。（10分） 七如圖3所示電路的計(jì)數(shù)長(zhǎng)度N是多少？能自啟動(dòng)嗎？畫(huà)出狀態(tài)轉(zhuǎn)換圖。（15分）數(shù)字電子技術(shù)試卷(06)一、 數(shù)制轉(zhuǎn)換（）、（）（ ）（）、（）（）（）、（127）（）（ ）、（）（）、（）原碼（）反碼=( )補(bǔ)碼二、選擇填空題（）、以下的說(shuō)法中，是正確的。a) 一個(gè)邏輯函數(shù)全部最小項(xiàng)之和恒等于b）一個(gè)邏輯函數(shù)全部最大項(xiàng)之和恒等于

14、c）一個(gè)邏輯函數(shù)全部最大項(xiàng)之積恒等于d）一個(gè)邏輯函數(shù)全部最大項(xiàng)之積恒等于）、若將一個(gè)異或門(mén)（輸入端為、）當(dāng)作反相器使用，則、端應(yīng)連接。a ）或有一個(gè)接 b）或有一個(gè)接c）和并聯(lián)使用d）不能實(shí)現(xiàn) ）、已知、是或非門(mén)構(gòu)成的基本觸發(fā)器的輸入端，則約束條件為。a ） b）c）d） ）、用級(jí)觸發(fā)器可以記憶種不同的狀態(tài)。a ） b）c） d）、由3級(jí)觸發(fā)器構(gòu)成的環(huán)形和扭環(huán)形計(jì)數(shù)器的計(jì)數(shù)模值依次為。a ）和 b）和c）和 d）和三、用卡諾圖化簡(jiǎn)法將下列邏輯函數(shù)化為最簡(jiǎn)與或形式（）（1）、（）、，給定約束條件為：四、 證明下列邏輯恒等式（方法不限）（）（）、（）五、 設(shè)計(jì)一位二進(jìn)制全減器邏輯電路。（，：被減數(shù)

15、，：減數(shù)，：借位輸入，：差，另有：借位輸出）（）六、分析如下時(shí)序電路的邏輯功能。、和是三個(gè)主從結(jié)構(gòu)的觸發(fā)器，下降沿動(dòng)作，輸入端懸空時(shí)和邏輯狀態(tài)等效。（）七、如圖所示，用555定時(shí)器接成的施密特觸發(fā)器電路中，試求：（）（）當(dāng)，而且沒(méi)有外接控制電壓時(shí)，、及值。（）當(dāng)，外接控制電壓時(shí)，、及各為多少。電子技術(shù)試卷(07)二、 數(shù)制轉(zhuǎn)換（12）1、（）（）（）2、（）（）（）3、（）（）（ ）4、（）（）5、（）原碼（）反碼=( )補(bǔ)碼二、選擇填空題（12）1）、以下的說(shuō)法中，是正確的。a) 一個(gè)邏輯函數(shù)全部最小項(xiàng)之和恒等于b）一個(gè)邏輯函數(shù)全部最大項(xiàng)之和恒等于c）一個(gè)邏輯函數(shù)全部最大項(xiàng)之積恒等于d）一個(gè)

16、邏輯函數(shù)全部最大項(xiàng)之積恒等于2）、已知、是與非門(mén)構(gòu)成的基本觸發(fā)器的輸入端，則約束條件為。a ） b）c） d）3）、若觸發(fā)器的原狀態(tài)為，欲在作用后仍保持為狀態(tài)，則激勵(lì)函數(shù)的值應(yīng)是。a ）=1， b），c）， d），4）、同步計(jì)數(shù)器是指的計(jì)數(shù)器。a ）由同類型的觸發(fā)器構(gòu)成。b）各觸發(fā)器時(shí)鐘端連在一起，統(tǒng)一由系統(tǒng)時(shí)鐘控制。c）可用前級(jí)的輸出做后級(jí)觸發(fā)器的時(shí)鐘。d）可用后級(jí)的輸出做前級(jí)觸發(fā)器的時(shí)鐘。）、同步四位二進(jìn)制計(jì)數(shù)器的借位方程是，則可知的周期和正脈沖寬度為。a ）個(gè)周期和個(gè)周期。b）個(gè)周期和個(gè)周期。c）個(gè)周期和個(gè)周期。d）個(gè)周期和個(gè)周期。三、用卡諾圖化簡(jiǎn)法將下列邏輯函數(shù)化為最簡(jiǎn)與或形式（12）

17、（1）、（2）、Y（，）=（m，m，m，m，m），給定約束條件為：mmmmm六、 證明下列邏輯恒等式（方法不限）（12）（1）、（2）、五、分析下圖所示電路中當(dāng)A、單獨(dú)一個(gè)改變狀態(tài)時(shí)是否存在競(jìng)爭(zhēng)冒險(xiǎn)現(xiàn)象？如果存在，那么都發(fā)生在其它變量為何種取值的情況下？（16）六、分析如下時(shí)序電路的邏輯功能，寫(xiě)出電路的驅(qū)動(dòng)方程、狀態(tài)方程和輸出方程，畫(huà)出電路的狀態(tài)轉(zhuǎn)換圖（20）。七、如圖所示，用反相器組成的施密特觸發(fā)器電路中，若，試求電路的輸入轉(zhuǎn)換電平、以及回差電壓。（16）數(shù)字電子技術(shù)試卷(08)三、 數(shù)制轉(zhuǎn)換（）：1、（）（）（）2、（）（）（）3、（）（）（ ）4、（）原碼（）反碼=( )補(bǔ)碼5、（）原碼

18、（）反碼=( )補(bǔ)碼二、選擇填空題（）、主從觸發(fā)器是。a ）在上升沿觸發(fā) b）在下降沿觸發(fā)c）在穩(wěn)態(tài)觸發(fā)d）與無(wú)關(guān) )、觸發(fā)器的特性方程是。a ） b）c）d) ）、用級(jí)觸發(fā)器可以記憶種不同的狀態(tài)。a ） b）c） d）、存在約束條件的觸發(fā)器是。a ）基本觸發(fā)器 b）D鎖存器c）觸發(fā)器 d）觸發(fā)器）、構(gòu)成模值為的二進(jìn)制計(jì)數(shù)器，需要級(jí)觸發(fā)器。a ） b）c） d）三、判斷題：判斷下列說(shuō)法是否正確，正確的打“”，錯(cuò)誤的打“”。（）、個(gè)“”連續(xù)異或的結(jié)果是。（）、已知邏輯，則。（）、已知邏輯，則。（）、函數(shù)連續(xù)取次對(duì)偶，不變。 （）、正“與非”門(mén)也就是負(fù)“或非”門(mén)。（）四、用卡諾圖化簡(jiǎn)法將下列邏輯函

19、數(shù)化為最簡(jiǎn)與或形式（）（）、（）、，給定約束條件為：五、 證明下列邏輯恒等式（方法不限）（）（1）、（）、（）、六、試畫(huà)出用線線譯碼器和門(mén)電路產(chǎn)生如下多輸出邏輯函數(shù)的邏輯電路圖。（：輸入、；輸出）（）七、分析如下時(shí)序電路的邏輯功能，寫(xiě)出電路的驅(qū)動(dòng)方程、狀態(tài)方程和輸出方程，畫(huà)出電路的狀態(tài)轉(zhuǎn)換圖。（）八、試敘述施密特觸發(fā)器的工作特點(diǎn)及主要用途。（） 數(shù)字電子技術(shù)試卷(09)四、 數(shù)制轉(zhuǎn)換(10)：、（）（）（）、（）（）（）、（0）（）（ ）、（）原碼（）反碼=( )補(bǔ)碼、（）原碼（）反碼=( )補(bǔ)碼二、選擇填空題（）、同步計(jì)數(shù)器是指的計(jì)數(shù)器。a ）由同類型的觸發(fā)器構(gòu)成。b）各觸發(fā)器時(shí)鐘端連在一起

20、，統(tǒng)一由系統(tǒng)時(shí)鐘控制。c）可用前級(jí)的輸出做后級(jí)觸發(fā)器的時(shí)鐘。d）可用后級(jí)的輸出做前級(jí)觸發(fā)器的時(shí)鐘。）、已知是同步十進(jìn)制計(jì)數(shù)器的觸發(fā)器輸出，若以做進(jìn)位，則其周期和正脈沖寬度是。a ）個(gè)周期和個(gè)周期。b）個(gè)周期和個(gè)周期。c）個(gè)周期和個(gè)周期。d）個(gè)周期和個(gè)周期。）、若四位同步二進(jìn)制計(jì)數(shù)器當(dāng)前的狀態(tài)是，下一個(gè)輸入時(shí)鐘脈沖后，其內(nèi)容變?yōu)?。a ）b）c）d）、若四位二進(jìn)制加法計(jì)數(shù)器正常工作時(shí)，由狀態(tài)開(kāi)始計(jì)數(shù)，則經(jīng)過(guò)個(gè)輸入計(jì)數(shù)脈沖后，計(jì)數(shù)器的狀態(tài)應(yīng)是。a ）b）c）d）、在下列功能表示方法中，不適合用于時(shí)序邏輯電路功能表示方法的是。a ）狀態(tài)轉(zhuǎn)換圖b）特性方程c）卡諾圖d）數(shù)理方程三、用邏輯代數(shù)的基本公式和

21、常用公式將下列邏輯函數(shù)化為最簡(jiǎn)與或形式（10）（1）、（2）、四、用卡諾圖化簡(jiǎn)法將下列邏輯函數(shù)化為最簡(jiǎn)與或形式（10）（1）、（2）、Y（，）=（m，m，m，m），給定約束條件為：mmmm五、 證明下列邏輯恒等式（方法不限）（10）（1）、（2）、六、試用四位并行加法器74LS283設(shè)計(jì)一個(gè)加/減運(yùn)算電路。當(dāng)控制信號(hào)時(shí)它將兩個(gè)輸入的四位二進(jìn)制數(shù)相加，而時(shí)它將兩個(gè)輸入的四位二進(jìn)制數(shù)相減。允許附加必要的門(mén)電路。（74LS283：輸入變量(A3A2A1A0)、(B3B2B1B0)及，輸出變量(S3S2S1S0)及）(15)七、對(duì)某同步時(shí)序電路，已知狀態(tài)表如下表所示，若電路的初始狀態(tài)，輸入信號(hào)波形如圖

22、所示，試畫(huà)出、 的波形（設(shè)觸發(fā)器響應(yīng)于負(fù)跳變）(15)。 X 01110 0011 01 1八、在圖所示的權(quán)電阻網(wǎng)絡(luò)D/A轉(zhuǎn)換器中，若取，試求當(dāng)輸入數(shù)字量為d3d2d1d0=0101時(shí)輸出電壓的大小(15)。數(shù)字電子技術(shù)試卷(10)五、 數(shù)制轉(zhuǎn)換（）：、（）（）（）、（17 ）（）（ ）、（）（）、（）原碼（）反碼=( )補(bǔ)碼、（）原碼（）反碼=( )補(bǔ)碼二、選擇填空題（）1）、若將一個(gè)異或門(mén)（輸入端為、）當(dāng)做反相器使用，則、端應(yīng)連接。a ）或有一個(gè)接 b）或有一個(gè)接c）和并聯(lián)使用d）不能實(shí)現(xiàn) 2）、由級(jí)觸發(fā)器構(gòu)成的二進(jìn)制計(jì)數(shù)器，其模值。a ） b）c）d）3）、已知是同步十進(jìn)制計(jì)數(shù)器的觸發(fā)器

23、輸出，若以做進(jìn)位，則其周期和正脈沖寬度是。a ）個(gè)周期和個(gè)周期。b）個(gè)周期和個(gè)周期。c）個(gè)周期和個(gè)周期。d）個(gè)周期和個(gè)周期。4）、在下列功能表示方法中，不適合用于時(shí)序邏輯電路功能表示方法的是。a ）狀態(tài)轉(zhuǎn)換圖b）特性方程c）卡諾圖d）數(shù)理方程5）、用反饋復(fù)位法來(lái)改變位二進(jìn)制加法計(jì)數(shù)器的模值，可以實(shí)現(xiàn)模值范圍的計(jì)數(shù)器。a ）b）c）d）三、用邏輯代數(shù)的基本公式和常用公式將下列邏輯函數(shù)化為最簡(jiǎn)與或形式（） （）、（）、四、用卡諾圖化簡(jiǎn)法將下列邏輯函數(shù)化為最簡(jiǎn)與或形式（）（）、（）、Y（，）=（m，m，m，m，m，m），給定約束條件為：mmmm五、證明下列邏輯恒等式（方法不限）（）（1）、（）六、分

24、析下圖所示電路中當(dāng)A、單獨(dú)一個(gè)改變狀態(tài)時(shí)是否存在競(jìng)爭(zhēng)冒險(xiǎn)現(xiàn)象？如果存在，那么都發(fā)生在其它變量為何種取值的情況下？（）七、試分析下圖所示時(shí)序電路，畫(huà)出其狀態(tài)表和狀態(tài)圖。設(shè)電路的初始狀態(tài)為，畫(huà)出在圖示波形圖作用下，和 的波形圖（）。八、比較并聯(lián)比較型A/D轉(zhuǎn)換器、逐次漸近型A/D轉(zhuǎn)換器和雙積分型A/D轉(zhuǎn)換器的優(yōu)缺點(diǎn)，指出它們各適于哪些情況下采用（）。數(shù)字電子技術(shù)試卷(11)一、 選擇（20分）1、一個(gè)四輸入端與非門(mén)，使其輸出為0的輸入變量取值組合有 種。A.15 B.7 C.3 D.12、對(duì)于JK觸發(fā)器，若J=K，則可完成 觸發(fā)器的邏輯功能。A.RS B.D C.T D.T3、為實(shí)現(xiàn)將JK觸發(fā)器轉(zhuǎn)

25、換為D觸發(fā)器，應(yīng)使 。A.J=D,K= B. K=D,J= C.J=K=D D.J=K=4、多諧振蕩器可產(chǎn)生 。A.正弦波 B.矩形脈沖 C.三角波 D.鋸齒波5、石英晶體多諧振蕩器的突出優(yōu)點(diǎn)是 。A.速度高 B.電路簡(jiǎn)單 C.振蕩頻率穩(wěn)定 D.輸出波形邊沿陡峭6、把一個(gè)五進(jìn)制計(jì)數(shù)器與一個(gè)四進(jìn)制計(jì)數(shù)器串聯(lián)可得到 進(jìn)制計(jì)數(shù)器。 A.4 B.5 C.9 D.207、N個(gè)觸發(fā)器可以構(gòu)成最大計(jì)數(shù)長(zhǎng)度（進(jìn)制數(shù)）為 的計(jì)數(shù)器。 A.N B.2N C. D. 2N8、同步時(shí)序電路和異步時(shí)序電路比較，其差異在于后者 。A.沒(méi)有觸發(fā)器 B.沒(méi)有統(tǒng)一的時(shí)鐘脈沖控制C.沒(méi)有穩(wěn)定狀態(tài) D.輸出只與內(nèi)部狀態(tài)有關(guān)9、五個(gè)

26、D觸發(fā)器構(gòu)成環(huán)形計(jì)數(shù)器，其計(jì)數(shù)長(zhǎng)度為 。A.5 B.10 C.25 D.3210、一位8421BCD碼計(jì)數(shù)器至少需要 個(gè)觸發(fā)器。A.3 B.4 C.5 D.10二、 填空題（20分）1、邏輯函數(shù)F=+B+D的反函數(shù)= 。2、邏輯函數(shù)F=A（B+C）1的對(duì)偶函數(shù)是 。3、已知函數(shù)的對(duì)偶式為+，則它的原函數(shù)為 。4、時(shí)序邏輯電路按照其觸發(fā)器是否有統(tǒng)一的時(shí)鐘控制分為 時(shí)序電路和 時(shí)序電路。5、如下圖題2-5a和圖題2-5b所示的電路，寫(xiě)出對(duì)應(yīng)的邏輯關(guān)系表達(dá)式圖題2-5b圖題2-5aY1= ， Y2= 6、完成數(shù)制轉(zhuǎn)換（11011.110）2 =（ ）10 = （ ）16（29）10 =（ ）2 =

27、（ ）16三、 （12分）用卡諾圖法化簡(jiǎn)下列函數(shù)為最簡(jiǎn)與或式，并用與非門(mén)實(shí)現(xiàn)電路（1） F1（A，B，C，D）=m（2，3，6，7，8，10，12，14）（2） F2（A，B，C，D）=四、 （15分）試畫(huà)出用3線-8線譯碼器74LS138和必要的門(mén)電路產(chǎn)生如下多輸出邏輯函數(shù)的邏輯圖74LS138功能表如表題4，74LS138邏輯電路圖如圖題4表題4S1A2A1A001111111111111111110000011111111000110111111100101101111110011111011111010011110111101011111101110110111111011011111

28、111110圖題4五、 （13分）施密特觸發(fā)器CT1014組成圖題5a所示電路，圖題5b為CT1014的電壓傳輸特性曲線，試定性畫(huà)出Va和Vo處的波形。圖題5a圖題5b六、 20分）分析圖題6所示電路的功能，畫(huà)出電路的轉(zhuǎn)換圖和時(shí)序圖。說(shuō)明電路能否自啟動(dòng)。圖題6數(shù)字電子技術(shù)試卷(12)一、 選擇題（20分）1. 一個(gè)四輸入端與非門(mén)，使其輸出為0的輸入變量取值組合有 種A.15，B.7 C.3 D.12. 已知（111）X=（1057）10，則X= 。A.4 B.8C.16D.323. 當(dāng)邏輯函數(shù)有n個(gè)變量時(shí)，共有 個(gè)變量取值組合？ A. n B. 2n C. n2 D. 2n4. 在何種輸入情況

29、下，“與非”運(yùn)算的結(jié)果是邏輯0。 A全部輸入是0 B.任一輸入是0 C.僅一輸入是0 D.全部輸入是15. 一個(gè)觸發(fā)器可記錄一位二進(jìn)制代碼，它有 個(gè)穩(wěn)態(tài)。A.0 B.1 C.2 D.3 E.46存儲(chǔ)8位二進(jìn)制信息要 個(gè)觸發(fā)器。A.2 B.3 C.4 D.87對(duì)于D觸發(fā)器，欲使Qn+1=Qn，應(yīng)使輸入D= 。A.0 B.1 C.Q D.8下列觸發(fā)器中，沒(méi)有約束條件的是 。A.基本RS觸發(fā)器 B.主從RS觸發(fā)器 C.同步RS觸發(fā)器 D.邊沿D觸發(fā)器9若在編碼器中有50個(gè)編碼對(duì)象，則要求輸出二進(jìn)制代碼位數(shù)為 位。 A.5 B.6 C.10 D.5010.欲設(shè)計(jì)0，1，2，3，4，5，6，7這幾個(gè)數(shù)的

30、計(jì)數(shù)器，如果設(shè)計(jì)合理，采用同步二進(jìn)制計(jì)數(shù)器，最少應(yīng)使用 級(jí)觸發(fā)器。A.2 B.3 C.4 D.8二、 填空題（20分）1一個(gè)基本RS觸發(fā)器在正常工作時(shí)，它的約束條件是+=1，則它不允許輸入= 且= 的信號(hào)。2.數(shù)字電路按照是否有記憶功能通?？煞譃閮深悾?、 。3時(shí)序邏輯電路按照其觸發(fā)器是否有統(tǒng)一的時(shí)鐘控制分為 時(shí)序電路和 時(shí)序電路。4. 描述同步時(shí)序電路有三組方程，指的是 、 和 5. 寫(xiě)出圖2-5所示函數(shù)Y1和Y2的邏輯表達(dá)式。設(shè)電路元件參數(shù)的選取滿足邏輯要求。圖題2-5Y1= Y2= 6、完成數(shù)制轉(zhuǎn)換 （78.8）16=（ ）10（76543.21）8=（ ）16 （110110111）2

31、=（ ）10=（ ）16三、 （10分）用卡諾圖法將邏輯函數(shù)化為最簡(jiǎn)與或式。（1） Y1（ABCD）=m（0，1，2，3，4，6，8，9，10，11，14）（2） Y2=四、 （15分）試?yán)?線-8線譯碼器74LS138設(shè)計(jì)一個(gè)多輸出的組合邏輯電路。輸出的邏輯函數(shù)式為1） Z1=2） Z2=Z3） Z3=4） Z4=74LS138功能表如表題4，74LS138邏輯電路圖如圖題4表題4S1A2A1A001111111111111111110000011111111000110111111100101101111110011111011111010011110111101011111101110

32、110111111011011111111110圖題4五、 （15分）圖5（a）是5G555內(nèi)部原理框圖，圖5（b）為它的符號(hào)，圖中為低觸發(fā)端，TH為高觸發(fā)端，為清零端，C-V為控制電壓端，DIS為放電端，OUT為輸出端。1） 試討論=1，C-V經(jīng)0.01uF電容接地時(shí)， TH和兩端輸入不同電壓，5G555的OUT的輸出情況，即劃出5G555的功能表2） 圖5（c）中，若VCC=+5V，則電路的VT+，VT-，V各為多少伏？3） 畫(huà)出圖5（c）電路的電壓傳輸特性曲線Vo=f（Vi）。若在Vi端加三角波，峰-峰值為+5V -5V，定性劃出Vo的波形。圖題5（a）圖題5（c）圖題5（b）六、 （2

33、0分）J-KFF觸發(fā)器構(gòu)成的計(jì)數(shù)器電路如圖題6所示。分析電路功能，說(shuō)明電路是幾進(jìn)制計(jì)數(shù)器，能否自啟動(dòng)。畫(huà)出其狀態(tài)轉(zhuǎn)換圖。圖題6數(shù)字電子技術(shù)試卷（1）參考答案一 填空1 1111011，7B 2 8613 與，或，非4 0，1，高阻5 真值表，邏輯圖，邏輯表達(dá)式，卡諾圖，波形圖（時(shí)序圖）6 波形的整形7 20伏8 并行A/D，串并行A/D，逐次比較A/D，雙積分A/D（寫(xiě)出三種）二 判斷題1 2345三化簡(jiǎn)邏輯函數(shù)12四， ，全加器，Y為和，為進(jìn)位。五，六采用D觸發(fā)器，電路圖略。將非工作狀態(tài)101，110，111帶入方程得次態(tài)，101001，110101001，111001，電路可以自啟動(dòng)。七f

34、 =65Hz數(shù)字電子技術(shù)（2）參考答案一 填空題（16）1 100011.110，23.C2 0，13 當(dāng)前輸入，原狀態(tài)4 0，1，高阻；任何時(shí)候，只能有1個(gè)三態(tài)門(mén)被選通。5 有兩個(gè)穩(wěn)態(tài)，在觸發(fā)信號(hào)作用下?tīng)顟B(tài)可相互轉(zhuǎn)變，有記憶功能6 延時(shí)7 5.5v8 13二 判斷題（10）12345三 化簡(jiǎn)題（14）12四（15）五（15） ， 六（15）驅(qū)動(dòng)方程：， 邏輯功能：X=0時(shí)，同步三進(jìn)制計(jì)數(shù)器；X1時(shí)，同步三進(jìn)制減法計(jì)數(shù)器。 該電路為同步三進(jìn)制可逆計(jì)數(shù)器，并且能自啟動(dòng)。七(15) 數(shù)字電子答案3一 填空題（16）1 1010110，100001102 73 16，64 狀態(tài)轉(zhuǎn)換表，狀態(tài)轉(zhuǎn)換圖，特

35、性方程5 06 2564bit7 5.275伏8 轉(zhuǎn)換精度，轉(zhuǎn)換速度二 回答問(wèn)題（10）1 不正確。當(dāng)X=0時(shí)，YZ，等式成立。2 五進(jìn)制計(jì)數(shù)器，10000/52KHz三 化簡(jiǎn)函數(shù)（14）1 A+C2四(15)五(15)1表示正常工作，0表示出故障；設(shè)用R,Y,G表示紅，黃，綠燈：1表示燈亮，0表示燈滅。六(15) 驅(qū)動(dòng)方程：; 狀態(tài)方程：，輸出方程： 七數(shù)字電子試卷答案4一 填空題（16）111.1023,4651伏616，871.1RC8轉(zhuǎn)換速度，轉(zhuǎn)換精度二 回答問(wèn)題（10）1 不正確。當(dāng)X=0時(shí)，YZ，等式仍然成立。2 正確。只有X=Y=0或X=Y=1時(shí)，等式X+Y=XY才成立。三 化簡(jiǎn)

36、函數(shù)12四功能：全減器，A為被減數(shù)，B為減數(shù)，C為低位的借位；位本位差，為向高位的借位。五 ， 六M=3,使用2個(gè)D觸發(fā)器 ，電路自啟動(dòng)檢查：設(shè)00，代入方程求次態(tài)為10，該電路能自啟動(dòng)。七f =65Hz數(shù)字電子技術(shù)試卷答案5一、選擇題（從每小題的四個(gè)備選答案中，選出一個(gè)正確答案，并將其號(hào)碼填在括號(hào)內(nèi)，每小題2分，共20分） 1. 2. 3. 4. 5. 6. 7. 8. 9. 10. 二判斷題（20分）1（ ）2（ ）3（ ）4（ ）5（ ）6（ ）7（ ）8（ ）9（ ）10（ ）三簡(jiǎn)答（10分）1答：RS觸發(fā)器: JK觸發(fā)器: 其中RS觸發(fā)器有約束方程，因?yàn)镽S觸發(fā)器有不允許的輸入條件。

37、2證：右= 左=右， 證畢！四用卡諾圖化簡(jiǎn)（10分） 五（15分）根據(jù)圖1，可列出Y得真值表A B CY0 0 00 0 10 1 00 1 11 0 01 0 11 1 01 1 1 0 0 0 1 0 1 1 1 由真值表可得Y得卡諾圖，化簡(jiǎn)得六（10分）解：根據(jù)數(shù)據(jù)選擇器的工作原理，由圖可得：七（15分）解：電路狀態(tài)方程為：狀態(tài)圖如下： 可見(jiàn)N=5, 能自啟動(dòng)。數(shù)字電子技術(shù)試卷參考答案（06）六、 數(shù)制轉(zhuǎn)換（）答案：、（）（）（）、（）（）（）、（127）（）（）、（）（）、（）原碼（）反碼=( )補(bǔ)碼二、選擇填空題（）答案： 1)d 2)a 3)a 4)d 5)d三、用卡諾圖化簡(jiǎn)法將下

38、列邏輯函數(shù)化為最簡(jiǎn)與或形式（）答案：（1）、（）、七、 證明下列邏輯恒等式（方法不限）（）答案：用公式法或卡諾圖法以及其他方法均可。八、 設(shè)計(jì)一位二進(jìn)制全減器邏輯電路。（）答案：列出真值表，得邏輯表達(dá)式（并化簡(jiǎn)），畫(huà)出邏輯電路圖。上式可化簡(jiǎn)：據(jù)上式用邏輯電路實(shí)現(xiàn)。六、分析如下時(shí)序電路的邏輯功能。（）答案：據(jù)邏輯圖寫(xiě)出電路的驅(qū)動(dòng)方程：） 求出狀態(tài)方程：）寫(xiě)出輸出方程：) 列出狀態(tài)轉(zhuǎn)換表或狀態(tài)轉(zhuǎn)換圖或時(shí)序圖： Y0 0 00 0 10 1 00 1 11 0 01 0 11 1 01 1 10 0 10 1 00 1 11 0 01 0 11 1 00 0 00 0 0000000115)從以上看

39、出，每經(jīng)過(guò)個(gè)時(shí)鐘信號(hào)以后電路的狀態(tài)循環(huán)變化一次；同時(shí)，每經(jīng)過(guò)個(gè)時(shí)鐘脈沖作用后輸出端輸出一個(gè)脈沖，所以，這是一個(gè)七進(jìn)制記數(shù)器，端的輸出就是進(jìn)位。七、如圖所示，用555定時(shí)器接成的施密特觸發(fā)器電路中，試求：（）解：（）(2/3)=8，(1/3)=4，(/3)=（），/5，/數(shù)字電子技術(shù)試卷參考答案(07)一、 數(shù)制轉(zhuǎn)換（12）答案：1、（）（）（）2、（）（）（）3、（）（）（ ）4、（）（）5、（）原碼（）反碼=( )補(bǔ)碼二、選擇填空題（12）答案：1)d 2)d 3)c 4)b 5)b三、用卡諾圖化簡(jiǎn)法將下列邏輯函數(shù)化為最簡(jiǎn)與或形式（12）答案：（1）、（2）、四、證明下列邏輯恒等式（方法不限

40、）（12）答案：用公式法或卡諾圖法以及其他方法均可。五、分析下圖所示電路中當(dāng)A、單獨(dú)一個(gè)改變狀態(tài)時(shí)是否存在競(jìng)爭(zhēng)冒險(xiǎn)現(xiàn)象？如果存在，那么都發(fā)生在其它變量為何種取值的情況下？（16）答案： 當(dāng)，即，時(shí)，將出現(xiàn)競(jìng)爭(zhēng)冒險(xiǎn)現(xiàn)象。當(dāng)，即，時(shí)，將出現(xiàn)競(jìng)爭(zhēng)冒險(xiǎn)現(xiàn)象。當(dāng)，即，時(shí)，將出現(xiàn)競(jìng)爭(zhēng)冒險(xiǎn)現(xiàn)象。當(dāng)，即，即，、不全為時(shí)，將出現(xiàn)競(jìng)爭(zhēng)冒險(xiǎn)現(xiàn)象。六、分析如下時(shí)序電路的邏輯功能，寫(xiě)出電路的驅(qū)動(dòng)方程、狀態(tài)方程和輸出方程，畫(huà)出電路的狀態(tài)轉(zhuǎn)換圖（20）。答案：）據(jù)邏輯圖寫(xiě)出電路的驅(qū)動(dòng)方程：） 求出狀態(tài)方程：）寫(xiě)出輸出方程：) 列出狀態(tài)轉(zhuǎn)換表或狀態(tài)轉(zhuǎn)換圖：）從狀態(tài)轉(zhuǎn)換圖可得出：該電路作為四進(jìn)制可控計(jì)數(shù)器使用。當(dāng)時(shí)，是一個(gè)加法計(jì)數(shù)器，當(dāng)時(shí)，是一個(gè)減法計(jì)數(shù)器。七、（16）解：(1+R1/R2) =(1+R1/R2) =3(1R1/R2) =(1R1/R2) =。數(shù)字電子技術(shù)試卷參考答案(08)一、 數(shù)制轉(zhuǎn)換（）：答案：1、（）（）（）2、（）（）